//====================================================================== // IrisSubpMemoryMap.h // IRISサブプロセッサ メモリマップ定数 // // Copyright (C) 2002-2004 NINTENDO Co.,Ltd. //====================================================================== #ifndef _IRIS_SUBP_MEMORY_MAP_H #define _IRIS_SUBP_MEMORY_MAP_H #ifdef __cplusplus extern "C" { #endif #include //---------------------------------------------------------------------- // メモリ・マップ //---------------------------------------------------------------------- #define SHARED_WORK 0x027ff000 // ＣＰＵ間共有ワーク領域 #define SHARED_WORK_END 0x02800000 #if defined(NDEBUG) #define SUBP_PRV 0x02380000 // サブプロセッサ専有領域（リリースバージョン） #elif defined(MMEM_4M) #define SUBP_PRV 0x02300000 // （デバッグバージョン＜メインメモリ４Ｍ本体＞） #else #define SUBP_PRV 0x02600000 // （デバッグバージョン＜メインメモリ８Ｍ本体＞） #endif #define SUBP_PRV_END SHARED_WORK #define MAIN_MEM 0x02000000 // メインメモリ #define MAIN_MEM_END (MAIN_MEM + 0x400000) #define MAIN_MEM_EX_END (MAIN_MEM + 0x800000) //（拡張時の最終アドレス） #define MAIN_MEM_CMD_AREA (MAIN_MEM_EX_END - 0x2) // メインメモリコマンド発行エリア（使用禁止エリア） #define SHARED_LOCK_BUF (MAIN_MEM_EX_END - 0x40) // 共有リソース・ロックバッファ #define SHARED_LOCK_BUF_END (MAIN_MEM_EX_END - 0x10) #define INIT_LOCK_BUF (MAIN_MEM_EX_END - 0x10) // 初期化ロックバッファ #define CARTRIDGE_LOCK_BUF (MAIN_MEM_EX_END - 0x18) // カートリッジ・ロックバッファ #define CARD_LOCK_BUF (MAIN_MEM_EX_END - 0x20) // カード・ロックバッファ #define WRAM_BLOCK1_LOCK_BUF (MAIN_MEM_EX_END - 0x28) // ＣＰＵ内部ワークＲＡＭ・ブロック１・ロックバッファ #define WRAM_BLOCK0_LOCK_BUF (MAIN_MEM_EX_END - 0x30) // ブロック０・ロックバッファ #define VRAM_D_LOCK_BUF (MAIN_MEM_EX_END - 0x38) // ＶＲＡＭ−Ｄ・ロックバッファ #define VRAM_C_LOCK_BUF (MAIN_MEM_EX_END - 0x40) // Ｃ・ロックバッファ #define TO_MAINP_IF_BUF (MAIN_MEM_EX_END - 0x50) // サブ→メインプロセッサ割り込み要求フラグ（２Ｂｙｔｅ×８） #define WM_TO_MAINP_IF_BUF (MAIN_MEM_EX_END - 0x50) // ワイヤレスマネージャ予約 #define FROM_MAINP_IF_BUF (MAIN_MEM_EX_END - 0x60) // メイン→サブプロセッサ割り込み要求フラグ（２Ｂｙｔｅ×８） #define WM_FROM_MAINP_IF_BUF (MAIN_MEM_EX_END - 0x60) // ワイヤレスマネージャ予約 #define ROM_HEADER_BUF (MAIN_MEM_EX_END - 0x200)// ＲＯＭ内登録エリアデータ・バッファ #ifdef IRIS_TS #define PRV_WRAM_DF_SIZE 0x8000 // ＣＰＵ内部専有ワークＲＡＭ ＴＳ−ＴＥＧ差分サイズ #else #define PRV_WRAM_DF_SIZE 0 #endif #define CPU_WRAM 0x037f8000 // ＣＰＵ内部ワークＲＡＭ ３ブロック構成時（デフォルト） #define CPU_WRAM_END (CPU_WRAM + PRV_WRAM_DF_SIZE + 0x10000) #define CPU_WRAM_2B 0x037fc000 // ２ブロック構成時 #define CPU_WRAM_2B_END (CPU_WRAM_2B + PRV_WRAM_DF_SIZE + 0xc000) #define CPU_WRAM_BLOCK0 0x037f8000 // ブロック０ #define CPU_WRAM_BLOCK0_END (CPU_WRAM_BLOCK0 + 0x4000) #define CPU_WRAM_BLOCK1 0x037fc000 // ブロック１ #define CPU_WRAM_BLOCK1_END (CPU_WRAM_BLOCK1 + 0x4000) #define PRV_WRAM 0x03800000 // ＣＰＵ内部専有ワークＲＡＭ #define PRV_WRAM_END (PRV_WRAM + PRV_WRAM_DF_SIZE + 0x8000) #define CPU_XWRAM 0x06000000 // ＣＰＵ内部拡張ワークＲＡＭ #define CPU_XWRAM_END (CPU_XWRAM +0x40000) #define INTR_VECTOR_BUF (CPU_WRAM_END - 0x4)// 割り込み分岐アドレス #define INTR_CHECK_BUF (CPU_WRAM_END - 0x8)// 割り込みチェック #define SEND_FIFO_LOCK_BUF (CPU_WRAM_END - 0x10)// ＣＰＵ間送信ＦＩＦＯ・ロックバッファ #define TIMER3_LOCK_BUF (CPU_WRAM_END - 0x12)// タイマー３・ロックバッファ #define TIMER2_LOCK_BUF (CPU_WRAM_END - 0x14)// タイマー２ #define TIMER1_LOCK_BUF (CPU_WRAM_END - 0x16)// タイマー１ #define TIMER0_LOCK_BUF (CPU_WRAM_END - 0x18)// タイマー０ #define DMA3_LOCK_BUF (CPU_WRAM_END - 0x1a)// ＤＭＡ３・ロックバッファ #define DMA2_LOCK_BUF (CPU_WRAM_END - 0x1c)// ＤＭＡ２ #define DMA1_LOCK_BUF (CPU_WRAM_END - 0x1e)// ＤＭＡ１ #define DMA0_LOCK_BUF (CPU_WRAM_END - 0x20)// ＤＭＡ０ #define REG_BASE 0x04000000 // レジスタ群 #define WIRELESS_INTF 0x04800000 // 無線通信インタフェース #define WIRELESS_INTF0 0x04800000 // インタフェース０ #define WIRELESS_INTF1 0x04808000 // インタフェース１ #define WIRELESS_INTF0_END (WIRELESS_INTF0 + 0x8000) #define WIRELESS_INTF1_END (WIRELESS_INTF1 + 0x8000) #define WIRELESS_INTF_END (WIRELESS_INTF + 0x10000) #define CARTRIDGE 0x08000000 // カートリッジ #define CTRDG_AD16_BANK0 0x08000000 // カートリッジ ＡＤ１６バス バンク０ #define CTRDG_AD16_BANK0_END 0x0a000000 #define CTRDG_AD16_BANK1 0x0a000000 // バンク１ #define CTRDG_AD16_BANK1_END 0x0c000000 #define CTRDG_AD16_BANK2 0x0c000000 // バンク２ #define CTRDG_AD16_BANK2_END 0x0e000000 #define CTRDG_DT8 0x0e000000 // カートリッジ ８ｂｉｔデータバス #define CTRDG_DT8_END 0x10000000 //---------------------------------------------------------------------- // メモリ・サイズ //---------------------------------------------------------------------- #define SHARED_WORK_SIZE (SHARED_WORK_END - SHARED_WORK) // ＣＰＵ間共有ワーク領域（４ＫＢ以上、２のべき乗サイズ） #define SUBP_PRV_SIZE (SUBP_PRV_END - SUBP_PRV) // サブプロセッサ専有領域（３２ＫＢ以上、２のべき乗サイズ） #define SHARED_LOCK_BUF_SIZE (SHARED_LOCK_BUF_END - SHARED_LOCK_BUF) // 共有リソース・ロックバッファ #define MAIN_MEM_SIZE 0x400000 // メインメモリ #define MAIN_MEM_EX_SIZE 0x800000 // （拡張時） #define CPU_WRAM_SIZE (0x10000 + PRV_WRAM_DF_SIZE) // ＣＰＵ内部ワークＲＡＭ ３ブロック構成時（デフォルト） #define CPU_WRAM_2B_SIZE (0xc000 + PRV_WRAM_DF_SIZE) // ２ブロック構成時 #define CPU_WRAM_BLOCK0_SIZE 0x4000 // ブロック０ #define CPU_WRAM_BLOCK1_SIZE 0x4000 // ブロック１ #define PRV_WRAM_SIZE (0x8000 + PRV_WRAM_DF_SIZE) // ＣＰＵ内部専有ワークＲＡＭ #define CPU_XWRAM_SIZE 0x40000 // ＣＰＵ内部拡張ワークＲＡＭ #define MROM_PAGE_SIZE 512 // マスクＲＯＭ・ページ #define CARTRIDGE_SIZE 0x02000000 // カートリッジ #define CTRDG_AD16_BANK_SIZE 0x02000000 // カートリッジ ＡＤ１６バス バンク #define CTRDG_AD16_BANK0_SIZE 0x02000000 // バンク０ #define CTRDG_AD16_BANK1_SIZE 0x02000000 // バンク１ #define CTRDG_AD16_BANK2_SIZE 0x02000000 // バンク２ #define CTRDG_DT8_SIZE 0x02000000 // カートリッジ ８ｂｉｔデータバス //---------------------------------------------------------------------- // レジスタ・アドレス //---------------------------------------------------------------------- #define REG_IME (REG_BASE + 0x208) // 割り込みマスタイネーブル #define REG_IE (REG_BASE + 0x210) // 割り込み許可 #define REG_IF (REG_BASE + 0x214) // 割り込み要求 #define REG_MAINPINTF (REG_BASE + 0x180) // メインプロセッサインタフェース #define REG_MAINP_FIFO_CNT (REG_BASE + 0x184) // ＣＰＵ間ＦＩＦＯコントロール #define REG_SEND_FIFO (REG_BASE + 0x188) // 送信ＦＩＦＯ #define REG_RECV_FIFO (REG_BASE + 0x100000) // 受信ＦＩＦＯ #define REG_POWCNT (REG_BASE + 0x304) // パワーコントロール #define REG_EXMEMCNT (REG_BASE + 0x204) // 外部メモリコントロール #define REG_VRAMSTAT (REG_BASE + 0x240) // ＶＲＡＭステータス #define REG_WRAMSTAT (REG_BASE + 0x241) // 内部ワークＲＡＭステータス #define REG_WVRAMSTAT (REG_BASE + 0x240) // ＶＲＡＭ Ｃ・Ｄ ＋ 内部ワークＲＡＭ ステータス #define REG_DISPSTAT (REG_BASE + 0x4) // 表示ステータス #define REG_VCOUNT (REG_BASE + 0x6) // Ｖカウンタ #define REG_SPICNT (REG_BASE + 0x1c0) // SPIコントロール #define REG_SPIDATA (REG_BASE + 0x1c2) // SPIデータ #define REG_RCNT (REG_BASE + 0x134) // 汎用入出力コントロール #define REG_KEYINPUT (REG_BASE + 0x130) // キー入力 #define REG_KEYCNT (REG_BASE + 0x132) // キーコントロール #define REG_DMA0 (REG_BASE + 0xb0) // ＤＭＡ０ #define REG_DMA0SAD (REG_BASE + 0xb0) #define REG_DMA0DAD (REG_BASE + 0xb4) #define REG_DMA0CNT (REG_BASE + 0xb8) #define REG_DMA0CNT_L (REG_BASE + 0xb8) #define REG_DMA0CNT_H (REG_BASE + 0xba) #define REG_DMA1 (REG_BASE + 0xbc) // ＤＭＡ１ #define REG_DMA1SAD (REG_BASE + 0xbc) #define REG_DMA1DAD (REG_BASE + 0xc0) #define REG_DMA1CNT (REG_BASE + 0xc4) #define REG_DMA1CNT_L (REG_BASE + 0xc4) #define REG_DMA1CNT_H (REG_BASE + 0xc6) #define REG_DMA2 (REG_BASE + 0xc8) // ＤＭＡ２ #define REG_DMA2SAD (REG_BASE + 0xc8) #define REG_DMA2DAD (REG_BASE + 0xcc) #define REG_DMA2CNT (REG_BASE + 0xd0) #define REG_DMA2CNT_L (REG_BASE + 0xd0) #define REG_DMA2CNT_H (REG_BASE + 0xd2) #define REG_DMA3 (REG_BASE + 0xd4) // ＤＭＡ３ #define REG_DMA3SAD (REG_BASE + 0xd4) #define REG_DMA3DAD (REG_BASE + 0xd8) #define REG_DMA3CNT (REG_BASE + 0xdc) #define REG_DMA3CNT_L (REG_BASE + 0xdc) #define REG_DMA3CNT_H (REG_BASE + 0xde) #define REG_TM0CNT (REG_BASE + 0x100) // タイマー０ #define REG_TM0CNT_L (REG_BASE + 0x100) #define REG_TM0CNT_H (REG_BASE + 0x102) #define REG_TM1CNT (REG_BASE + 0x104) // タイマー１ #define REG_TM1CNT_L (REG_BASE + 0x104) #define REG_TM1CNT_H (REG_BASE + 0x106) #define REG_TM2CNT (REG_BASE + 0x108) // タイマー２ #define REG_TM2CNT_L (REG_BASE + 0x108) #define REG_TM2CNT_H (REG_BASE + 0x10a) #define REG_TM3CNT (REG_BASE + 0x10c) // タイマー３ #define REG_TM3CNT_L (REG_BASE + 0x10c) #define REG_TM3CNT_H (REG_BASE + 0x10e) #define REG_SOUNDCNT (REG_BASE + 0x500) // サウンド・マスタコントロール #define REG_SOUNDBIAS (REG_BASE + 0x504) // サウンドＢＩＡＳ #define REG_SNDCAPCNT (REG_BASE + 0x508) // サウンドキャプチャコントロール #define REG_SNDCAP0DAD (REG_BASE + 0x510) // サウンドキャプチャ０パラメータ #define REG_SNDCAP0LEN (REG_BASE + 0x514) #define REG_SNDCAP1DAD (REG_BASE + 0x518) // サウンドキャプチャ１パラメータ #define REG_SNDCAP1LEN (REG_BASE + 0x51c) #define REG_SOUND0CNT (REG_BASE + 0x400) // サウンド０コントロール #define REG_SOUND0CNT_L (REG_BASE + 0x400) #define REG_SOUND0CNT_H (REG_BASE + 0x402) #define REG_SOUND0SAD (REG_BASE + 0x404) #define REG_SOUND0TMR (REG_BASE + 0x408) #define REG_SOUND0RPT_PT (REG_BASE + 0x40a) #define REG_SOUND0RPT_LEN (REG_BASE + 0x40c) #define REG_SOUND1CNT (REG_BASE + 0x410) // サウンド１コントロール #define REG_SOUND1CNT_L (REG_BASE + 0x410) #define REG_SOUND1CNT_H (REG_BASE + 0x412) #define REG_SOUND1SAD (REG_BASE + 0x414) #define REG_SOUND1TMR (REG_BASE + 0x418) #define REG_SOUND1RPT_PT (REG_BASE + 0x41a) #define REG_SOUND1RPT_LEN (REG_BASE + 0x41c) #define REG_SOUND2CNT (REG_BASE + 0x420) // サウンド２コントロール #define REG_SOUND2CNT_L (REG_BASE + 0x420) #define REG_SOUND2CNT_H (REG_BASE + 0x422) #define REG_SOUND2SAD (REG_BASE + 0x424) #define REG_SOUND2TMR (REG_BASE + 0x428) #define REG_SOUND2RPT_PT (REG_BASE + 0x42a) #define REG_SOUND2RPT_LEN (REG_BASE + 0x42c) #define REG_SOUND3CNT (REG_BASE + 0x430) // サウンド３コントロール #define REG_SOUND3CNT_L (REG_BASE + 0x430) #define REG_SOUND3CNT_H (REG_BASE + 0x432) #define REG_SOUND3SAD (REG_BASE + 0x434) #define REG_SOUND3TMR (REG_BASE + 0x438) #define REG_SOUND3RPT_PT (REG_BASE + 0x43a) #define REG_SOUND3RPT_LEN (REG_BASE + 0x43c) #define REG_SOUND4CNT (REG_BASE + 0x440) // サウンド４コントロール #define REG_SOUND4CNT_L (REG_BASE + 0x440) #define REG_SOUND4CNT_H (REG_BASE + 0x442) #define REG_SOUND4SAD (REG_BASE + 0x444) #define REG_SOUND4TMR (REG_BASE + 0x448) #define REG_SOUND4RPT_PT (REG_BASE + 0x44a) #define REG_SOUND4RPT_LEN (REG_BASE + 0x44c) #define REG_SOUND5CNT (REG_BASE + 0x450) // サウンド５コントロール #define REG_SOUND5CNT_L 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OFFSET_REG_VRAMSTAT 0x240 // ＶＲＡＭステータス #define OFFSET_REG_WRAMSTAT 0x241 // 内部ワークＲＡＭステータス #define OFFSET_REG_WVRAMSTAT 0x240 // ＶＲＡＭ Ｃ・Ｄ ＋ 内部ワークＲＡＭ ステータス #define OFFSET_REG_DISPSTAT 0x4 // ステータス #define OFFSET_REG_VCOUNT 0x6 // Ｖカウンタ #define OFFSET_REG_SPICNT 0x1c0 // SPIコントロール #define OFFSET_REG_SPIDATA 0x1c2 // SPIデータ #define OFFSET_REG_RCNT 0x134 // 汎用入出力コントロール #define OFFSET_REG_KEYINPUT 0x130 // キー入力 #define OFFSET_REG_KEYCNT 0x132 // キーコントロール #define OFFSET_REG_DMA0 0xb0 // ＤＭＡ０ #define OFFSET_REG_DMA0SAD 0xb0 #define OFFSET_REG_DMA0DAD 0xb4 #define OFFSET_REG_DMA0CNT 0xb8 #define OFFSET_REG_DMA0CNT_L 0xb8 #define OFFSET_REG_DMA0CNT_H 0xba #define OFFSET_REG_DMA1 0xbc // ＤＭＡ１ #define OFFSET_REG_DMA1SAD 0xbc #define OFFSET_REG_DMA1DAD 0xc0 #define OFFSET_REG_DMA1CNT 0xc4 #define OFFSET_REG_DMA1CNT_L 0xc4 #define OFFSET_REG_DMA1CNT_H 0xc6 #define OFFSET_REG_DMA2 0xc8 // ＤＭＡ２ #define OFFSET_REG_DMA2SAD 0xc8 #define OFFSET_REG_DMA2DAD 0xcc #define OFFSET_REG_DMA2CNT 0xd0 #define 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